chipscope使用教程（一步步教你如何进行Xilinx SerDes调试）
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一步步教你如何进行Xilinx SerDes调试
由于这种复杂性，SERDES的调试工作对很多工程师来说是一个挑战。本文将描述SERDES的一般调试方法，便于工程师准确快速定位和解决问题。 1. 硬件检测 硬件检测可以分为原理图/PCB检查和板上硬件检查。这一部分的工作相对简单，但是很多时候问题是由这些看起来很不起眼的地方导致的。 a) 原理图/PCB检查根据SERDES应用手册要求检查原理图和PCB设计。例如对于Xilinx 7系列GTX/GTH SERDES，可以参考UG476的Board Design Guidelines检查原理图和PCB设计。 b) 板上硬件检查使用示波器/万用表等仪器设备实际测量板上硬件，确认提供给SERDES的工作环境正常。 i. 检查电源的电压/精度/纹波/上电顺序是否符合数据手册的要求。例如对于Xilinx 7系列GTX SERDES，需要对照DS182检查。 ii. 检查SERDES参考时钟频率/摆幅是否符合数据手册的要求，以及参考时钟的管脚位置是否正确。 iii. 物理通道的检查，例如确认AC耦合电容的容值是否正确，光模块是否兼容，焊接是否正常。 2. 使用IBERT IBERT是一个强有力的调试工具，可以用于调整参数设置和确认系统余量，也可以用于故障现象判断。IBERT在CORE generator里产生工程和BIT文件。将BIT文件下载到FPGA后，使用ChipScope Analyzer连接到FPGA上，就会出现IBERT的GUI调试界面。a) 检查PLL是银樱否LOCK，如果没有，需要检查时钟和电源。比喊蔽如时钟频率是否正确，SERDES是否选择了正确的时钟源。b) 将SERDES的TX和RX设为相同的数据pattern，例如PRBS-31。设置SERDES为Near-end PMA模式。如果这一步不能工作，检查TX/RX极性是否反转；检查TXUSRCLK/TXUSRCLK2/RXUSRCLK/RXUSRCLK2上的时钟频率是否正常。通过这郑搏州一步保证SERDES内部工作正常。 c) 将SERDES设置为Far-end PMA和Far-end PCS模式，确认远端设备的SERDES是否收发正常。通过这一步排除和时钟OFFSET相关的问题。 d) 如果这些步骤工作正常，但是误码率很高，有可能是参数设置有问题。需要通过调整TX/RX的参数设置来解决。也可以通过EYE SCAN功能来得到最佳设置和判断系统余量。3. 通用的调试步骤 通常会使用一定的调试步骤来定位问题，避免重复工作。一开始，一般不进行整个工程的测试，而是基于SERDES的Wrappers工程，以方便定位问题。一般可以使用CORE generator里的Transceivers Wizard产生的Example Design。在Core generator里产生Transceivers Wizard的Example Design后，会输出源文件和scripts。利用scripts可以直接产生运行结果。Example Design里的数据产生和检测都是基于BRAM，可以很方便的修改数据。在工程里面，Chipscope VIOs and ILAs必须被加入到工程里面，进行控制和调试分析。a) 进行Near-end PCS测试。i. 启动SERDES复位（VIO）。ii. 确认复位结束(VIO)。iii. 检查SERDES状态信号（VIO）。iv. 使用计数器确认时钟频率（VIO）。 b) 进行Near-end PMA测试。i. 确认CDR工作正常，检测CDR产生的恢复时钟（VIO）。ii. Comma alignment和8B/10B状态检查（ILA）。 c) 正常操作检测i. 确认clock correction电路状态（ILA）。ii. 确认Channel bonding电路状态（ILA）。
chipvision使用
很抱歉，我不确定ChipVision的弊手具体使用方法，但是我可以为您提供一些有关在ISE 14.7中添加ChipVision到新工程的一般步骤：
1. 在ISE 14.7中建立新工程。
2. 选中顶层模块名led_top，右键选择“New Source”选项，选择“ChipScope_LED”并命名。
3. 点击“Finish”按钮，等待工如卜做程层次目录生成。
4. 双击“ChipScope_LED.cdc”文件，打开对话框，确保使用SRL和RPMs选中。
请注意，以上步骤渣衡是基于ISE 14.7版本的，如果您使用的是不同版本的的综合布局器，步骤可能会有所不同。如果您需要更具体的信息，建议您参考相关文档或者联系相关领域的专业人士。
怎样才能使用ChipScope 加入被优化掉的信号
第皮陵高一种方法：更改优化选项设置。
在ChipScope中添加一些引脚的信号，但列燃尺表中并没有显示，原因是综合的地方没设置好，应该将XST的属性设置成如下：keep hierarchy处为YES。
第二种方法：在RTL代码中进行一些声明。
对于wire型号，对于ISE12.3以后的版本，XST综合，可以使用(* KEEP="TRUE"*) wire AD_reg;这样的声明，就可以在查找信号的信号找到wire类型的AD_reg信号进行观察。
第三种方法：做一些不会被优化掉的冗余逻辑使想查看的信号不被汪圆优化掉。
如果某些信号使用了上面的两种方法还是不行的话，可是常常加一些冗余逻辑。加需要观察的信号打个节拍，然后接到引脚上，这时的信号是不会被优化掉的。在FPGA设计中常常都有一些空闲的引脚或者调试使用的引脚，将冗余逻辑的输出接到这些引脚上即可。
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